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Gestion dynamique tension/fréquence pour les mpsoc

AUTHOR Jmaa-Y
PUBLISHER Omniscriptum (02/28/2018)
PRODUCT TYPE Paperback (Paperback)

Description
L' volution des syst mes embarqu s vers des architectures multiprocesseurs sur puce (MPSOC) engendre des difficult s croissantes dans la conception des syst mes. L'optimisation de la consommation d' nergie est devenue une pr occupation fondamentale. La solution est d'utiliser diff rentes techniques d'optimisation de la consommation d' nergie et de puissance. Ce travail consiste int grer la technique DSR d'une mani re dynamique dans l'application radio logicielle. DSR est un algorithme bas sur la strat gie de ralentissement de la consommation d' nergie du processeur. Il assure la d tection d'ach vement des t ches, d termine la quantit du temps de ralentissement dynamique en comparant la pire dur e d'ex cution d'une t che par rapport son temps r el d'ex cution. Nous avons divis le travail sur deux parties: Estimation et optimisation de la consommation Puissance/Energie au niveau de la plateforme mat rielle et Estimation et optimisation de la consommation haut niveau.
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Product Format
Product Details
ISBN-13: 9783841665065
ISBN-10: 3841665063
Binding: Paperback or Softback (Trade Paperback (Us))
Content Language: French
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Page Count: 124
Carton Quantity: 58
Product Dimensions: 6.00 x 0.29 x 9.00 inches
Weight: 0.42 pound(s)
Country of Origin: FR
Subject Information
BISAC Categories
Computers | General
Computers | General
Descriptions, Reviews, Etc.
publisher marketing
L' volution des syst mes embarqu s vers des architectures multiprocesseurs sur puce (MPSOC) engendre des difficult s croissantes dans la conception des syst mes. L'optimisation de la consommation d' nergie est devenue une pr occupation fondamentale. La solution est d'utiliser diff rentes techniques d'optimisation de la consommation d' nergie et de puissance. Ce travail consiste int grer la technique DSR d'une mani re dynamique dans l'application radio logicielle. DSR est un algorithme bas sur la strat gie de ralentissement de la consommation d' nergie du processeur. Il assure la d tection d'ach vement des t ches, d termine la quantit du temps de ralentissement dynamique en comparant la pire dur e d'ex cution d'une t che par rapport son temps r el d'ex cution. Nous avons divis le travail sur deux parties: Estimation et optimisation de la consommation Puissance/Energie au niveau de la plateforme mat rielle et Estimation et optimisation de la consommation haut niveau.
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